数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 31160|排名: 32

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键盘扫描时使用CASE语句产生的奇怪问题	hugooh 2008-6-3	33034	elec_zxm 2012-12-11 14:38
[求助] 跨板阻抗匹配的问题	xuruomu 2012-12-10	96043	chugnhsienlee 2012-12-11 13:14
[原创] DDR II调试不知道怎么着手？？跪求调试步骤！！！	q3634098 2012-12-8	32401	q3634098 2012-12-10 19:30
[求助] altera 使用partition后资源不够	tide 2012-12-6	23868	abab8780000 2012-12-10 17:44
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[求助] quartus中的simulation不能获取问题	renzhu2008 2012-12-10	01531	renzhu2008 2012-12-10 17:05
请问综合后仿真路径延迟反标时找不到触发器的路径延迟路径的问题？	yifan225 2005-9-2	44348	czqczqczq28 2012-12-10 15:39
[求助] ISE工程打不开	houjibin 2010-3-14	47008	箭猪zjy 2012-12-10 11:08
[求助] verilog parameter的使用问题	yushuiyang1986 2012-12-7	514491	ysxiliu 2012-12-9 22:19
[求助] vhdl ds18b20	addingmm 2012-12-9	02165	addingmm 2012-12-9 16:53
[求助] 求解verilog	fengyiyong 2012-12-7	62354	xmffsf 2012-12-8 20:49
[求助] modelsim6.5仿真时存在的一个问题！！！	furnace 2012-12-8	02073	furnace 2012-12-8 14:32
[求助] 请大神推荐带ＵＳＢ２．０的ＦＰＧＡ开发板	sgcseu 2012-11-30	73124	tiangua 2012-12-7 23:43
[求助] 大家modelsim中都在使用哪个脚本语言	qiudanyi1 2012-12-5	72423	tiangua 2012-12-7 23:37
[求助] 在使用quartus11.0软件调用modelsim进行波形仿真时出现下列错误	黑曼巴4724 2012-12-7	02727	黑曼巴4724 2012-12-7 21:35
[求助] ALtera的PCIE硬核，runtb.do文件的仿真	hexuezu 2012-5-18	12350	kira545699636 2012-12-7 17:51
[求助] DC综合时如何设置才能保证某个信号不被优化掉	yl5495 2012-10-30	43804	thunderwalk 2012-12-7 15:56
[讨论] FPGA祛除多余符号位的方法	leozh 2012-12-3	52915	see123 2012-12-7 14:02
[求助] PCI Express自由顺序发送数据	longxigen 2012-12-6	32216	see123 2012-12-7 12:30
[求助] PLL的问题	achunjcc 2011-11-29	63927	see123 2012-12-7 12:28
[求助] 关于阻塞赋值与非阻塞赋值 ...2	mingtianwendy 2012-11-29	103736	see123 2012-12-7 12:19
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[求助] 关于乘法器的问题	xiaohesdu 2012-12-6	02959	xiaohesdu 2012-12-6 21:20
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