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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › 可综合的VERILOG语法

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楼主: llcai

可综合的VERILOG语法

发表于 2009-12-17 10:12:40 | 显示全部楼层

谢谢分享。

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beckham07360736

发表于 2009-12-17 16:46:02 | 显示全部楼层

good~~~~

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发表于 2010-5-15 21:02:10 | 显示全部楼层

thanks sharing

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发表于 2011-9-8 12:11:28 | 显示全部楼层

Thanks！

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发表于 2011-9-8 21:02:24 | 显示全部楼层

thanks

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发表于 2012-6-14 08:41:12 | 显示全部楼层

感谢分享啊

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发表于 2012-8-14 13:46:15 | 显示全部楼层

kankan shi sha

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发表于 2013-9-29 13:32:14 | 显示全部楼层

JM6I9KLKO8IK

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发表于 2016-7-5 21:53:53 | 显示全部楼层

谢谢了。。。。。

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