请教Verilog A的收敛问题。

JonesWork · 发表于 2022-5-6 10:57:54

YaochangLi 发表于 2022-4-8 15:11
我写了一个adc 有同样的错误但是我单独仿真adc
就没有问题，要是和其他模块一起仿真就会报错，就只是放在 ...

你好请问你有解决吗？我也是这样的情况，单独仿没问题，但是和别的模块放在一起就会报错说不收敛

YaochangLi · 发表于 2022-6-21 10:46:35

JonesWork 发表于 2022-5-6 10:57
你好请问你有解决吗？我也是这样的情况，单独仿没问题，但是和别的模块放在一起就会报错说不收敛

...

我换代码就可以了

wjlsjm · 发表于 2025-4-14 11:36:22

YaochangLi 发表于 2022-4-8 15:11
我写了一个adc 有同样的错误但是我单独仿真adc
就没有问题，要是和其他模块一起仿真就会报错，就只是放在 ...

我也遇到这样的问题，请问怎么解决

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