DC综合verilog

anpengfei · 发表于 2020-9-12 15:31:10

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RTL代码中定义了integer，DC综合报warning就是无符号数赋给有符号数(integer)这类的，不会报error吗？
integer要改成reg吗？还是现在可以综合integer了？

anpengfei · 发表于 2020-9-12 15:45:37

综合后的网表我也可以后仿……这是怎么回事，不是说integer类型不能综合吗？
求大佬们指教谢谢

A1985 · 发表于 2020-9-13 15:29:43

integer ~~ reg signed [31:0]

anpengfei · 发表于 2020-9-14 10:35:22

A1985 发表于 2020-9-13 15:29
integer ~~ reg signed [31:0]

哦这样啊，谢谢大佬指教

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