怎么 shrink cell

ydlm42sj · 发表于 2012-10-11 11:41:46

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cell 两层metal ，现在想要缩小到原来的0.8，怎么办？ cell不是管子

damonzhao · 发表于 2012-10-12 18:12:26

谁能明白他在说啥？

ilovecolin · 发表于 2012-10-15 10:34:47

看来没有人明白他再说什么

andy2000a · 发表于 2012-10-15 16:04:07

早期 tools
dream

更早期  CIF => ascii file . 直接改 width , 但只是把一些METAL PATH 縮小,
現在TOOLS 就不清處.
如果是 circuit shrink => cadence  neoCircuit

hoody4032 · 发表于 2012-10-16 06:58:10

Thanks. Good to know.

peterlin2010 · 发表于 2012-10-16 08:03:10

SEE
http://bbs.eetop.cn/viewthread.php?tid=293224

GDS shrink

andy2000a · 发表于 2012-10-16 10:08:06

一般如 tsmc 0.13 => optic shrink 0.11um
or  0.25-> 0.23um
會先用  shrink spice model , all circuit W.L  will keep , and 直接跑 shrink 後 model .

layout GDS 會維持直接出用光學去SHRINK 0.9

motofatfat · 发表于 2012-10-17 09:37:40

cell 两层metal ，现在想要缩小到原来的0.8，怎么办？ cell不是管
問題不夠明確

layout 上 instan 時設倍數 0.8 就會縮小了
flat 一階就得到 0.8 ㄉ layou ㄌt

ydlm42sj · 发表于 2012-10-21 18:54:39

多谢楼上明白

liufeiluan · 发表于 2016-8-2 13:45:50

回复 8# motofatfat

在51系统中，create instance 时可以设置，但是在61系统中就找不到这个功能了，怎么办呢？

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