LAYOUT的LVS添加添加添加empty_subckt.sp_cal文件

xiaokaihua · 发表于 2023-5-31 21:58:20

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我在做lvs验证时候，添加了网表文件也看了相关的定义，网表文件里面都有，但是做验证还是显示认不到添加的mime2r-ckt和rhrpo-ckt电阻，就很郁闷大佬们怎么弄啊！！！

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maomao198477 · 发表于 2023-5-31 23:28:59

你这显然有重新提了阿，提好网表后再add

kearney2020 · 发表于 2023-6-1 09:26:27

maomao198477 发表于 2023-5-31 23:28
你这显然有重新提了阿，提好网表后再add

你好，请问怎么样提取empty_subckt.sp_cal文件？谢谢！

yguvyg · 发表于 2023-6-1 09:33:06

把export from schematic viewer的勾勾去掉（这个勾勾代表calibre会自己按照你指定的路径去提取网表，但是你已经把网表添加进来了，就不需要它自己去提取了）然后你的网表应该还少了一个跟layout比对的网表，这个你也可以自己抽好添加进来

xiaokaihua · 发表于 2023-6-1 11:00:50

yguvyg 发表于 2023-6-1 09:33
把export from schematic viewer的勾勾去掉（这个勾勾代表calibre会自己按照你指定的路径去提取网表，但是 ...

请问一下怎么抽取啊

yguvyg · 发表于 2023-6-1 11:06:54

xiaokaihua 发表于 2023-6-1 11:00
请问一下怎么抽取啊

呃，就是正常的导出cdl流程，在virtuoso界面file--Export--CDL，如果还有不懂得可以请教你身边的人，我这没法展示

xiaokaihua · 发表于 2023-6-1 11:08:45

yguvyg 发表于 2023-6-1 11:06
呃，就是正常的导出cdl流程，在virtuoso界面file--Export--CDL，如果还有不懂得可以请教你身边的人，我这 ...

好的，非常感谢

xiaokaihua · 发表于 2023-6-2 09:37:05

maomao198477 发表于 2023-5-31 23:28
你这显然有重新提了阿，提好网表后再add

好的，已经解决了非常感谢！

DramaFun · 发表于 2023-12-8 16:43:31

我刚刚也是添加之后显示查找不到器件。试过几次后发现，是因为在跑之前，原理图输出的网表不存在，直接添加empty会把红色的原理图网标直接替换掉。在勾选原理图输出的时候，先跑一下，提示缺少模型，再进行添加就可以了。

wind_able · 发表于 2023-12-8 17:11:33

可以在这里加载，然后保存至你的runset，就不用每次都加载

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