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楼主: cxl666

IC6151破解版32/64bit

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发表于 2018-9-12 19:51:35 | 显示全部楼层
当data_in为15 *(1 + sin(x))且T = 62.8时,测试结果
来自Modsim的显示在图7中,其中“滞后”阵列存储
自动相关的36x64位导致36滞后。“INTF*”
和“intp *”是8的对称归一化的数据集
诸如“Int I”之类的阶段用于具有8个数字的第一阶段
“data_in”信号是正弦波刺激,“术语”是
刺激数据的总数(30 72),“intc”是总和
这些刺激数据。
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发表于 2018-9-12 19:52:46 | 显示全部楼层
模拟结果为36滞后多,相关器为
用于正弦波刺激的最终后合成模块
T = 62.8,T = 628,绘制在图9和图10中。红色
这些图上的曲线是Matlab程序的仿真结果
(步骤1),在ISE上进行VHDL后合成仿真结果(步骤1)
3)以黑色曲线显示。 此外,1024'1'线性
显示了Matlab的相关器模拟结果
与多方法比较的目的,显示
这两种方法在滞后之前都非常接近
来到正弦波刺激时期。
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发表于 2018-9-12 19:54:28 | 显示全部楼层
从图9和图10中,我们可以清楚地看到
VHDL的仿真结果完全重叠
Matlab程序。
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发表于 2018-9-12 19:55:36 | 显示全部楼层
数据输入最大相关值为
对于图9,T = 62.8,对于图10,T = 628'1',最小
在半T处相关,证明了正弦的自然
波。
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发表于 2018-9-12 19:56:33 | 显示全部楼层
这证明了VHDL相关器的功能是
正确。
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发表于 2018-9-12 20:02:04 | 显示全部楼层
这种36滞后相关器的256个元件与之集成在一起
结构如图11所示,结构为36组
DSP模块,利用Vertex的24套DSP模块
Xilinx的芯片与每个相关器元件分开
作为全局DSP的中心化,用于256位数据输入
不同的阶段,比2的时钟周期快256倍
0.1
'1'
同步DSP块以从“data_in”信号中斩波数据
在2 n.1之内
,在每个阶段的时期,再次n是
阶段号码。
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发表于 2018-9-12 20:03:57 | 显示全部楼层
这样的DSP结构数量减少了
设计中使用的DSP模块称为桶形移位器DSP
本文的结构
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发表于 2018-9-12 20:05:16 | 显示全部楼层
费米实验室和BNL的科学家开发了X射线
硅探测器和相应的ASIC芯片
VIPIC [4]如前所述收集强度计数
X射线。
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发表于 2018-9-12 20:06:41 | 显示全部楼层
VIPIC芯片针对单色进行了优化
8 keY的光子束。
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发表于 2018-9-12 20:07:42 | 显示全部楼层
原型由64x64组成
像素硅探测器阵列。
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