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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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ZYYZNB
发表于 2024-3-6 14:24:20 | 显示全部楼层
学习下
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发表于 2024-3-6 14:34:18 | 显示全部楼层
谢谢分享
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发表于 2024-3-6 23:20:45 | 显示全部楼层
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hetyu
发表于 2024-3-7 14:53:36 | 显示全部楼层
瞅瞅
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发表于 2024-3-7 21:03:46 | 显示全部楼层
Thanks
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发表于 2024-3-8 00:16:15 | 显示全部楼层
kankan
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发表于 2024-3-8 10:40:51 | 显示全部楼层
kankan
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发表于 2024-3-8 10:59:24 | 显示全部楼层
Kankan
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发表于 2024-3-8 18:11:19 | 显示全部楼层
学习下
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发表于 2024-3-27 12:45:22 | 显示全部楼层
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