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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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binnq
发表于 2024-5-24 16:16:03 | 显示全部楼层
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发表于 2024-5-30 00:56:02 | 显示全部楼层
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binnq
发表于 2024-5-30 09:04:54 | 显示全部楼层
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Retr0
发表于 2024-5-30 23:03:26 | 显示全部楼层
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ic886
发表于 2024-5-30 23:16:29 | 显示全部楼层
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kenboy
发表于 2024-6-26 17:10:01 | 显示全部楼层
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发表于 2024-7-3 20:57:37 | 显示全部楼层
顶一个
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mylihua
发表于 2024-7-4 01:48:58 | 显示全部楼层
好好学习，感谢分享
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发表于 2024-7-5 01:07:47 | 显示全部楼层
看看，学习一下
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发表于 2024-7-5 12:11:24 | 显示全部楼层
:victory::victory::victory::victory::victory:
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