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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › PR过后netlist转成晶体管级原理图
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楼主: 942627356

[原创] PR过后netlist转成晶体管级原理图

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发表于 2021-8-20 23:23:45 | 显示全部楼层
好东西 下的看看~~~
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sofie
发表于 2021-8-24 10:09:46 | 显示全部楼层
好东西，找时间试一下
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发表于 2021-8-30 17:28:06 | 显示全部楼层
感谢分享。
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fox127
发表于 2021-9-7 11:58:30 | 显示全部楼层
thank you a lot
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lei_001
发表于 2021-9-8 09:43:21 | 显示全部楼层
看看~~~
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发表于 2022-2-9 15:50:20 | 显示全部楼层
好试试
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zhh124
发表于 2022-2-9 16:10:25 | 显示全部楼层
calibre v2lvs，将verilog netlist 转cdl，用于LVS
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ichsim
发表于 2022-3-8 10:42:00 | 显示全部楼层
感谢分享
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发表于 2022-10-7 17:16:25 来自手机 | 显示全部楼层
感谢！
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发表于 2023-9-6 17:31:40 | 显示全部楼层

make_digital_stdcel 不会用！
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