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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › Verilog HDL数字设计与综合 （第二版）
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楼主: LIFLASH

Verilog HDL数字设计与综合 （第二版）

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发表于 2009-5-21 17:10:08 | 显示全部楼层
我也想要看
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发表于 2009-5-21 17:11:14 | 显示全部楼层
我也要看啊
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发表于 2009-5-21 17:13:42 | 显示全部楼层
我也想要看看看
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发表于 2009-5-22 08:24:37 | 显示全部楼层
zhichi
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发表于 2009-5-22 08:32:07 | 显示全部楼层
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发表于 2009-5-22 08:34:01 | 显示全部楼层
支持，前列之地
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发表于 2009-5-22 08:35:58 | 显示全部楼层
不会说我灌水吧
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发表于 2009-5-22 08:39:00 | 显示全部楼层
不会说我灌水吧
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发表于 2009-5-22 08:40:51 | 显示全部楼层
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发表于 2009-5-22 08:46:03 | 显示全部楼层
我不想灌水的
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