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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › DC综合之时序约束，公司内部解密

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楼主: graduate2010

[资料] DC综合之时序约束，公司内部解密

发表于 2023-7-20 15:20:13 | 显示全部楼层

666666

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发表于 2023-7-20 16:37:25 | 显示全部楼层

这是做fpga的x家的，不是s家的

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发表于 2023-7-27 11:21:23 | 显示全部楼层

好东西

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发表于 2023-7-27 15:16:09 | 显示全部楼层

谢谢分享

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发表于 2023-8-7 11:03:16 | 显示全部楼层

谢谢分享！

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发表于 2023-8-10 16:54:35 | 显示全部楼层

參考看看謝謝

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发表于 2023-8-22 11:43:29 | 显示全部楼层

ty！

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发表于 2024-7-24 13:49:55 | 显示全部楼层

no money i want to load

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qingtianxiaojia

发表于 2024-7-26 14:54:44 | 显示全部楼层

看看~~

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发表于 2024-8-1 11:34:55 | 显示全部楼层

看看

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