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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › SPI经典IP核 verilog
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楼主: jiangyq

[资料] SPI经典IP核 verilog

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发表于 2010-8-14 00:04:24 | 显示全部楼层
谢谢楼主~~~~~~~~~~~~~
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lixi123
发表于 2010-8-18 00:26:11 | 显示全部楼层
看看那---------------
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发表于 2010-8-18 08:49:23 | 显示全部楼层
貌似在哪里见过
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发表于 2010-8-18 16:30:15 | 显示全部楼层
看看谢谢
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发表于 2010-8-20 10:09:03 | 显示全部楼层
看看 谢谢分享
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发表于 2010-8-22 11:52:58 | 显示全部楼层
XXX
XXX
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发表于 2010-8-22 14:06:40 | 显示全部楼层
这个一定要顶的
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tzl123
发表于 2010-8-25 10:54:53 | 显示全部楼层
fasdfas
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fable5
发表于 2010-9-7 15:58:06 | 显示全部楼层
顶起。
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发表于 2010-9-14 16:48:01 | 显示全部楼层
我什么不能多点详细说明呢
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