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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › usb2.0接口verilog源代码
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楼主: ymjcloud

[资料] usb2.0接口verilog源代码

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zstj
发表于 2016-2-8 16:02:24 | 显示全部楼层
不错，支持
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发表于 2016-2-8 17:43:54 | 显示全部楼层
hello!
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pol123
发表于 2016-2-8 20:18:28 | 显示全部楼层
谢谢分享。看一看
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Ryggeor
发表于 2016-2-13 03:00:23 | 显示全部楼层
thnx!
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mlqe
发表于 2016-12-29 15:06:13 | 显示全部楼层
感谢分享
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发表于 2017-3-21 23:10:35 | 显示全部楼层
回复 1# ymjcloud


        thanks
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发表于 2017-3-22 09:28:41 | 显示全部楼层
感謝分享
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发表于 2017-3-22 09:35:15 | 显示全部楼层
感謝分享
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QQben
发表于 2017-3-22 09:37:54 | 显示全部楼层
谢谢分享
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Ryggeor
发表于 2017-3-22 15:00:49 | 显示全部楼层
thnx!
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