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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 华为海思采用的verilog编码规范
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楼主: knight0123

[资料] 华为海思采用的verilog编码规范

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发表于 2016-5-19 17:18:17 | 显示全部楼层
下来看看是不是
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发表于 2016-5-23 15:04:50 | 显示全部楼层
kankan
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发表于 2016-5-23 16:07:52 | 显示全部楼层
学习一下
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发表于 2016-6-24 13:55:11 | 显示全部楼层
多谢楼主
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发表于 2016-6-25 09:33:05 | 显示全部楼层
谢谢楼主分享
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发表于 2016-7-6 16:37:41 | 显示全部楼层
学习了，谢谢楼主分享。
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发表于 2016-7-7 07:51:23 | 显示全部楼层
谢谢分享。。。
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发表于 2016-7-7 08:03:51 | 显示全部楼层
感谢楼主分享
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lx2116
发表于 2016-7-7 10:36:45 | 显示全部楼层
顶一个
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发表于 2016-7-9 20:44:49 | 显示全部楼层
回复 1# knight0123


   为啥是英文的？
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