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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › low power RTL 设计优化
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楼主: yaya126

[原创] low power RTL 设计优化

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xushixia
发表于 2017-12-8 12:29:43 | 显示全部楼层
MARK一下
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发表于 2018-1-11 19:38:16 | 显示全部楼层
楼主不错啊 刚入行的 过来看看
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发表于 2018-2-7 14:39:59 | 显示全部楼层
楼主愿意分享，目前最时髦的技术。佩服！！！
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rvisk
发表于 2018-2-9 17:37:03 | 显示全部楼层
帖子不错
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发表于 2018-2-22 15:26:48 | 显示全部楼层
好文！
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orlye
发表于 2018-2-25 16:45:02 | 显示全部楼层
学习了。
很佩服楼主精益求精的精神。
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发表于 2018-3-3 11:04:37 | 显示全部楼层
very good !!!
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发表于 2018-3-3 11:28:25 | 显示全部楼层
有没有说明文档啊？
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rvisk
发表于 2018-3-3 14:55:45 | 显示全部楼层
回复 1# yaya126


   Mark下，言之有物！
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发表于 2018-3-15 10:25:06 | 显示全部楼层
多谢楼主分享
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