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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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zeaprx
发表于 2018-11-27 21:51:08 | 显示全部楼层
太及时了，谢谢大佬
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发表于 2018-11-27 23:56:16 | 显示全部楼层
回复 1# yoof2000
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haevs
发表于 2018-11-28 06:05:13 | 显示全部楼层
回复 9# loveineda


    感謝無私分享
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发表于 2018-11-28 14:21:19 | 显示全部楼层
kanknaknakn
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发表于 2018-11-28 14:44:02 | 显示全部楼层
必须看看
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lijl_
发表于 2018-11-28 15:28:55 | 显示全部楼层
谢谢分享！!
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QQben
发表于 2018-11-29 08:48:35 | 显示全部楼层
谢谢分享
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发表于 2018-11-29 08:52:28 | 显示全部楼层
谢谢分享
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发表于 2018-11-29 15:56:43 | 显示全部楼层
来，这是所得税看
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zhangjr
发表于 2018-11-29 22:19:34 | 显示全部楼层
还是可以看看的值得学习
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