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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 华为海思采用的verilog编码规范
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楼主: knight0123

[资料] 华为海思采用的verilog编码规范

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splendo
发表于 2018-8-29 07:15:30 | 显示全部楼层
great
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sophiky
发表于 2018-8-29 09:45:42 | 显示全部楼层
谢谢楼主的分享
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adan313
发表于 2018-9-9 00:51:01 | 显示全部楼层
shibushia
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发表于 2018-9-10 17:53:58 | 显示全部楼层
谢谢分享啊
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发表于 2018-9-10 23:32:21 | 显示全部楼层
看看哈，谢谢先
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发表于 2018-9-11 14:15:41 | 显示全部楼层
顶顶顶顶顶多多多多多多多多多多多多多多多多
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发表于 2018-9-18 23:01:11 | 显示全部楼层
回复 1# knight0123


   感谢分享！！！
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发表于 2018-9-19 08:27:31 | 显示全部楼层
回复 1# knight0123

感谢分享！！！
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djiejie3
发表于 2018-9-19 10:44:45 | 显示全部楼层
希望对面试华为有用
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发表于 2018-9-25 21:40:37 | 显示全部楼层
loook
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