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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › system verilog 超级资料（中文）

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楼主: ise

system verilog 超级资料（中文）

发表于 2021-3-10 09:36:06 | 显示全部楼层

网页版的，看起来太累

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发表于 2021-3-10 21:22:44 | 显示全部楼层

非常感谢!

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发表于 2021-5-31 15:12:45 | 显示全部楼层

html 格式

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发表于 2021-8-18 03:59:19 | 显示全部楼层

Thanks!!!

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发表于 2021-8-18 08:23:47 | 显示全部楼层

good!

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发表于 2021-8-19 13:08:29 | 显示全部楼层

下载学习多谢

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发表于 2021-10-11 17:45:45 | 显示全部楼层

thanks

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发表于 2021-11-2 16:02:27 | 显示全部楼层

最近想看看SV的特性，下载看看

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发表于 2021-11-2 16:07:32 | 显示全部楼层

压缩包内容

压缩包内容

竟然是网页排版，体验不好

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发表于 2021-12-30 14:01:41 | 显示全部楼层

下载看看，看翻译的准确否

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