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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › DDR Timing Closure – Physicaldesign and STA
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楼主: nifan1977

DDR Timing Closure – Physicaldesign and STA

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发表于 2008-5-26 14:13:49 | 显示全部楼层

ddr

ddr good
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virgos
发表于 2008-7-18 11:59:04 | 显示全部楼层
ti DSP的DDR2接口pcb设计
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lgechao
发表于 2008-7-18 16:01:11 | 显示全部楼层
有dps自动校准的电路。
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icerbbs
发表于 2008-8-5 23:07:45 | 显示全部楼层

xiexie

下来看看
谢谢！
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发表于 2008-8-5 23:43:41 | 显示全部楼层
不是很了解  看看
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发表于 2008-8-11 10:57:23 | 显示全部楼层
不错不错
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发表于 2008-8-11 14:55:49 | 显示全部楼层
好东西多多益善啊！！！！！
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发表于 2008-8-14 18:57:31 | 显示全部楼层
:lol :lol
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发表于 2008-9-9 09:06:20 | 显示全部楼层
最近剛好在研究, 謝謝了!!
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jaceewen
发表于 2008-9-10 22:50:36 | 显示全部楼层
dddddddddddddddddddddddddddddd
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