在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
[求助] 关于8051IP核的疑惑  ...2 IC.Michael 2016-5-17 138791 huaashan 2021-9-23 17:29
[求助] 综合时能否指定某个模块使用特定的库 janlesion 2021-8-31 52206 janlesion 2021-9-23 11:40
[转贴] FPGA书目的泛读 精华3  ...23456..7 leasor 2013-11-10 6138774 durbin 2021-9-22 17:06
[讨论] ICV floating psub error 新人帖 rdemirci 2021-9-22 01743 rdemirci 2021-9-22 16:14
[求助] 求问为什么标准单元库中触发器有两个建立时间和保持时间 新人帖 dianfeng1995 2021-9-17 62380 Aries-go 2021-9-22 14:54
[求助] ncverilog warning 佳木秀繁阴 2021-9-14 32526 佳木秀繁阴 2021-9-22 13:24
[求助] 关于VREF管脚的连接问题 zst221000 2010-6-21 816521 yangwg1980 2021-9-22 12:41
[讨论] 抛砖引玉,同步器(一) 精华1  ...23 immonster 2011-9-6 2620719 durbin 2021-9-22 11:10
[求助] 如何对modesim对Vivado生成的网表文件进行仿真? 新人帖 fascinate_lyd 2019-9-4 77260 thanhmaikmt 2021-9-22 01:01
[求助] conformal smart check license kk2009 2021-9-20 02908 kk2009 2021-9-20 12:12
[求助] SYNOPSYS:DC&PrimeTime相关工艺库问题 - [悬赏 200 信元资产] sy1success 2015-10-10 97622 曾经擦肩 2021-9-19 22:38
[求助] 请问这些折叠的D触发器,怎么变成一个整体 - [悬赏 10 信元资产] weizqsocool 2021-9-18 32744 lizexc 2021-9-19 22:27
[求助] pcie IP 谁枫而飘 2016-8-6 67161 yzwbb2013 2021-9-19 20:41
[求助] 后仿问题大合集!相信很多过来的朋友都碰到过,希望大家多多交流~~~共同进步  ...23 Synopsys-IC 2013-5-22 2114339 曾经擦肩 2021-9-19 19:38
[求助] 同步时钟相位检测问题 sjcai 2021-9-13 32336 曾经擦肩 2021-9-19 19:33
[求助] 请问大神们:有没有跨FPGA平台的RTL加密办法? 新人帖  ...2 hunle 2021-9-16 125689 hunle 2021-9-18 17:11
[讨论] 比DesignWare DW01_add 更快的加法器? 新人帖 没蚊子 2021-9-18 02463 没蚊子 2021-9-18 13:57
[求助] cortex M0 eval版本能用于silicon吗? wyb512 2018-6-2 22528 tmd007 2021-9-17 21:22
[求助] 关于vivado安装错误 noname丶 2021-9-17 0998 noname丶 2021-9-17 11:00
[求助] 刚转IC,学习数字IC前段的需要掌握哪些语言 新人帖 yhji1334551882 2021-9-8 52408 yhji1334551882 2021-9-16 17:06
[原创] Spyglass 2018 prabakaran_vlsi 2021-9-5 43119 patrickchen 2021-9-16 16:30
[求助] Intel FPGA 100 Level Courses怎么能看 - [阅读权限 255] 西西在冰城 2021-9-16 01500 西西在冰城 2021-9-16 16:16
[求助] perl脚本 新人帖 王喜鑫 2021-9-15 93593 王喜鑫 2021-9-16 15:58
[原创] 可视化EDA开发工具  ...2 micbot 2021-9-8 117045 Johnmc104 2021-9-16 15:51
[求助] 请教Verdi显示schematic的算法 zsftm 2015-9-21 33345 ty_xiumud 2021-9-16 14:10
[求助] xilinx gth serdes ip 使用求助 lotfy 2021-9-15 12158 lotfy 2021-9-16 14:03
[求助] 21个input,如何判断其中是否有相等的呢  ...2 mysoul 2021-9-7 135272 durbin 2021-9-16 10:21
[求助] 求教VCS启动verilog文件时无法打开的问题 wwzh0729 2014-3-26 45989 那就这样 2021-9-15 16:21
[求助] 求助:哪里能下载synopsys design_ware的IP库 seahqsky 2014-12-10 23127 xingyuehui152 2021-9-15 14:38
[讨论] TDC设计  ...2 xylion 2016-4-7 1812090 cceenn 2021-9-15 09:59
[求助] IC618DRC验证提示Licensing Error 新人帖 黄焖鸡 2021-7-20 93173 marvel0725 2021-9-13 21:59
[原创] 新书《FPGA设计实战演练(高级技巧篇)》马上就要与读者见面了  ...234 coyoo 2015-5-13 3315141 zzlj560 2021-9-13 11:06
[求助] verilog2001中关于`define的作用域  ...2 masure 2013-12-26 1315184 smarthb 2021-9-13 10:20
[求助] spectre19.1输出的fsdb5.7怎么才能打开 shine724 2021-5-14 12495 shine724 2021-9-12 10:10
[讨论] vcs后仿真中如何避免X值? 河源皮 2017-11-28 78067 ClancyLee 2021-9-11 14:09
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2026-1-17 00:52 , Processed in 0.245667 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块