数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 31160|排名: 32

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[求助] 纠结一天了蛋都碎了。。很无耻求作业。。大概5分钟能完成就是不会写。。。	mikeren1991 2012-10-24	93270	chen.terry 2012-11-3 19:54
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关于color saturation的算法	lyu 2003-12-27	33363	張境 2012-11-3 17:32
[转帖]半导体产业IP复用现状概述	一声叹息 2003-12-3	38853	張境 2012-11-3 17:30
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[讨论] FPGA设计工具下载链接汇总	lucien_1986 2012-3-11	13934	張境 2012-11-3 17:07
[求助] ads S1P 作为端口阻抗	pmohujie 2012-11-3	03649	pmohujie 2012-11-3 16:48
[求助] 我调用好的fifo模块不知道端口怎么连，换句话说怎么设置offset	lichenjiee 2012-11-3	02299	lichenjiee 2012-11-3 15:30
[资料] dc运行出错，求大侠帮助！	kingnan 2012-11-3	02180	kingnan 2012-11-3 15:08
[求助] 求助：DC安装运行dv&出现问题	pinkoath 2010-9-28	42787	kingnan 2012-11-3 14:40
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[求助] 初学者求助，如何求信号的模	arwc 2012-11-2	12775	Gary.wang 2012-11-2 17:31
[求助] DC的area report和网表不符	rainoffire 2012-11-2	33524	Civil86 2012-11-2 15:49
[求助] 稍复杂时钟管理	gbsid 2012-11-1	32452	clean_water 2012-11-2 14:07
[求助] 请教Xilinx GTP的参考时钟问题	adrian7 2012-11-2	113581	eaglelsb 2012-11-2 12:38
[求助] 关于lib里面DFF的setup time和hold time!!!	Gary.wang 2012-11-1	34125	Gary.wang 2012-11-2 09:24
附件收入是什么意思？？？	liandan 2008-4-29	32585	kartic 2012-11-2 09:13
verilog_xl de 下载哪里有 (无内容)	qqmz 2004-3-28	13182	appleyuchi2 2012-11-2 00:54
[求助] 希望达人指导“时钟模块”设计，谢谢！	Gary.wang 2012-10-26	52313	wuxiaoqing1 2012-11-1 23:11
[求助] DC综合时顶层定义出错	日月木易 2012-11-1	28239	chrisyl 2012-11-1 14:35
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