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斑竹请帮我看看这个程序,在综合时提示错误!!!! yourazhe 2004-7-17 32893 bravelu 2004-7-18 19:51
Verilog中任务的调用  ...2 prguo 2003-11-19 108164 jsbv 2004-7-18 01:22
这个循环语句错在什么地方????????????? yourazhe 2004-7-15 17161 zigzag 2004-7-16 22:02
FSM问题 jamyce 2004-4-22 72970 yuzhicai 2004-7-16 21:59
怎样把dc综合出来的错误信息导入一个文件呢? yuzhicai 2004-7-16 21691 yuzhicai 2004-7-16 21:55
如何在FPGA中嵌入可以跑linux的CPU核 740625 2004-7-15 12297 jackzhang 2004-7-15 15:52
为什么ALTERA EPM7064S的输出高电平才3.5V 左右? (无内容) mikenee 2004-1-27 32719 灵犀 2004-7-15 11:40
关于CPLD/FPGA的入门 豆豆 2004-5-17 32109 yungold 2004-7-15 09:35
我有些EDA的软件,与大家交流 freedingcq 2004-6-24 72493 sjh324 2004-7-15 08:48
如何将一个信号延时10us后原样输出啊?(VHDL) yourazhe 2004-7-6 65476 风再起 2004-7-12 20:03
请大虾们帮个小忙,这们MAX的编译错误怎么解决啊? romyks 2004-7-12 13491 bravelu 2004-7-12 18:26
在vhdl 语言中,如何将一个信号与芯片的实际引脚相关联? yourazhe 2004-7-5 43655 zigzag 2004-7-9 18:08
找QUARTUS weiwu 2004-6-25 22383 blueray 2004-7-7 10:50
请问我怎么增加威望 toland 2004-7-6 12059 atuhappy 2004-7-7 10:39
求教:CORE GEN生成的FIFO进行行为级仿真的问题。  ...2 jamyce 2004-1-9 145904 wwjj0221 2004-7-7 09:25
[求助]如何进行网表转换啊 guanfree 2004-7-6 22718 guanfree 2004-7-6 21:50
[求助]买什么样的比较合适???? electronics 2004-7-6 12083 bravelu 2004-7-6 16:14
有没有HDLC转异步串口的例子 newbiew 2004-7-6 01602 newbiew 2004-7-6 14:08
maxplus编译错误? ncepu 2004-7-5 14997 bravelu 2004-7-5 12:07
征求已经在FPGA上验证过的8位单片机的核 740625 2004-7-3 22261 740625 2004-7-5 10:19
如何将CPLD(XILINX XC952156)的一个引脚与地相连? yourazhe 2004-7-2 33130 yourazhe 2004-7-3 14:17
求助代码问题 duanwuyu 2004-7-1 43812 duanwuyu 2004-7-1 13:20
[讨论]莱鸟问题~~ electronics 2004-6-30 22091 electronics 2004-6-30 16:37
ISE6。1(FPGA)综合时出现。这三个WARNING是什么意思??会不会影响稳定性?? ZLS 2004-6-4 45853 lixiangmmm 2004-6-29 13:12
模拟固定分区存储管理的分配与回收 aivt 2004-6-28 22887 liuiang 2004-6-28 18:21
[求助]各位大侠帮我解释这个问题,谢谢 colour88 2004-6-28 94888 colour88 2004-6-28 17:30
[求助]FPGA advantage5.4的license guanfree 2004-6-28 04584 guanfree 2004-6-28 16:44
[求助]请大侠们帮看此程序,小妹实在看不懂了  ...2 colour88 2004-6-18 183955 colour88 2004-6-28 00:12
有關if的編碼風格........看不懂ㄟ@@ yaolung 2004-6-26 11963 atuhappy 2004-6-27 13:58
[求助]计数器的同步级联! brotherjam 2004-6-27 46795 brotherjam 2004-6-27 13:52
在写CPLD程序时出现boundary-scan错误,该如何解决?(版主请进) yourazhe 2004-6-22 53852 jackzhang 2004-6-25 20:47
CPLD 的 GLOBAL CLEAR 可以用做一般的I/O口吗?还是必须要加这样一个信号电平上去 (无 灵犀 2004-6-25 15323 atuhappy 2004-6-25 16:04
asking for helping hypee 2004-6-15 32336 xudongyang 2004-6-25 13:35
[求助]verilog oasis77oasis 2004-6-25 42581 atuhappy 2004-6-25 13:02
关于jtag口 greenpine 2004-6-24 22244 greenpine 2004-6-24 22:28
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