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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › IEEE Std 1364™-2005（Verilog最新标准）

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楼主: ahii

IEEE Std 1364™-2005（Verilog最新标准）

liutongqiang_jn

发表于 2016-8-16 14:43:38 | 显示全部楼层

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发表于 2016-8-23 15:58:26 | 显示全部楼层

thanks

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发表于 2016-9-11 10:36:03 | 显示全部楼层

顶一顶不错的好东西

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发表于 2016-10-26 18:20:47 | 显示全部楼层

looklook

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发表于 2016-10-27 16:11:53 | 显示全部楼层

好东西

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发表于 2016-11-11 00:41:11 | 显示全部楼层

谢谢分享，楼主万岁

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发表于 2016-11-11 08:56:48 | 显示全部楼层

顶！！！！！！！！！！！！

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发表于 2017-9-24 19:59:12 | 显示全部楼层

O(∩_∩)O谢谢

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发表于 2017-10-28 00:02:35 | 显示全部楼层

不错不错

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发表于 2017-11-7 13:59:52 | 显示全部楼层

谢谢！

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