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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › IEEE Std 1364™-2005（Verilog最新标准）
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楼主: ahii

IEEE Std 1364™-2005（Verilog最新标准）

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发表于 2017-12-18 21:09:05 | 显示全部楼层
thx,XD
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发表于 2018-1-30 16:01:05 | 显示全部楼层
thanks for your sharing
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发表于 2018-5-19 19:40:49 | 显示全部楼层
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发表于 2018-5-22 11:35:13 | 显示全部楼层
回复 2# ahii

顶
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发表于 2018-5-24 20:08:53 | 显示全部楼层
学习学习。。。。
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tansiye
发表于 2018-5-29 11:36:20 | 显示全部楼层
谢谢楼主分享
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发表于 2018-6-11 16:59:05 | 显示全部楼层
thanks for sharing
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发表于 2018-6-21 14:26:17 | 显示全部楼层
好东西！！！！！
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发表于 2018-7-9 10:04:03 | 显示全部楼层
下载了，学习下。
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blanklog
发表于 2018-7-15 12:54:47 | 显示全部楼层
10年后的我来下载了！
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