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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › IEEE Std 1364™-2005（Verilog最新标准）
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楼主: ahii

IEEE Std 1364™-2005（Verilog最新标准）

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virtex2
发表于 2018-8-1 16:29:51 | 显示全部楼层
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发表于 2018-9-3 18:57:02 | 显示全部楼层
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sailsor
发表于 2018-10-17 22:03:53 | 显示全部楼层
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发表于 2018-10-26 13:06:04 | 显示全部楼层
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发表于 2018-11-29 09:23:42 | 显示全部楼层
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发表于 2018-12-25 14:28:04 | 显示全部楼层
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发表于 2019-1-19 09:50:24 | 显示全部楼层
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发表于 2019-1-23 13:24:19 | 显示全部楼层
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发表于 2019-1-24 00:41:14 | 显示全部楼层
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soullcy
发表于 2019-1-24 11:24:38 | 显示全部楼层
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