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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › verilog_hdl_高级数字设计源码
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楼主: eagle_tek

verilog_hdl_高级数字设计源码

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发表于 2010-1-1 23:35:47 | 显示全部楼层
看看了。。
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发表于 2010-1-2 21:04:16 | 显示全部楼层
好资源！
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发表于 2010-1-2 21:41:23 | 显示全部楼层
谢谢楼主共享！！！！
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haipsunj
发表于 2010-1-23 22:27:59 | 显示全部楼层
谢谢楼主
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发表于 2010-1-24 11:44:11 | 显示全部楼层
xie xie le ,hao yong  d
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lansky
发表于 2010-1-25 13:12:21 | 显示全部楼层
thanks
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spgto
发表于 2010-1-25 15:40:47 | 显示全部楼层
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发表于 2010-1-25 16:43:32 | 显示全部楼层
xie xie  hao dong xi
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发表于 2011-4-14 17:02:18 | 显示全部楼层
11111111111111111111111111111111111
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发表于 2011-7-27 21:22:39 | 显示全部楼层
海鸥是先下本书卡很难
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