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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › FPGA设计经典实例，高手必备的好材料！
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楼主: fxyyye

FPGA设计经典实例，高手必备的好材料！

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发表于 2010-6-5 21:03:07 | 显示全部楼层
谢谢，非常感谢
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发表于 2010-6-5 21:04:18 | 显示全部楼层
谢谢，非常感谢
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发表于 2010-6-5 21:05:41 | 显示全部楼层
谢谢，非常感谢
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发表于 2010-6-8 15:59:05 | 显示全部楼层
hao dongx ,xian kankan
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发表于 2010-6-8 19:32:36 | 显示全部楼层
谢谢，希望有用
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发表于 2010-6-8 19:35:10 | 显示全部楼层
good material
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发表于 2010-6-8 23:35:39 | 显示全部楼层
verilog还是VHDL？最近看VHDL看的头都疼。。
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发表于 2010-6-9 23:06:17 | 显示全部楼层
没办法没钱了，要定。。
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发表于 2010-6-9 23:07:26 | 显示全部楼层
要下3个还得继续顶啊
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发表于 2010-6-9 23:08:57 | 显示全部楼层
以后能不能改下呢，不用钱下
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