设为首页 收藏本站
在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码，快捷登录

手机号码，快捷登录

搜全文
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog_HDL_Test_Bench初级入门
12下一页
返回列表 发新帖
查看: 4264|回复: 17

Verilog_HDL_Test_Bench初级入门

[复制链接]
sqchang
发表于 2009-7-4 12:47:16 | 显示全部楼层 |阅读模式

相关帖子
回复

使用道具 举报

fcgyun
发表于 2009-7-4 21:03:27 | 显示全部楼层
回复 支持 反对

使用道具 举报

发表于 2009-7-8 06:25:53 | 显示全部楼层
回复 支持 反对

使用道具 举报

发表于 2009-7-8 14:01:41 | 显示全部楼层
回复 支持 反对

使用道具 举报

发表于 2009-7-17 14:28:56 | 显示全部楼层
EETOP创芯人才网简历投递入口
回复 支持 反对

使用道具 举报

wecof
发表于 2009-7-18 01:11:48 | 显示全部楼层
EETOP创芯人才网职位发布入口
回复 支持 反对

使用道具 举报

发表于 2009-7-31 17:05:25 | 显示全部楼层
EETOP创芯人才网简历投递入口
回复 支持 反对

使用道具 举报

发表于 2009-7-31 18:51:35 | 显示全部楼层
EETOP创芯人才网职位发布入口
回复 支持 反对

使用道具 举报

发表于 2009-8-5 03:06:30 | 显示全部楼层
EETOP创芯人才网简历投递入口
回复 支持 反对

使用道具 举报

发表于 2009-9-8 21:11:26 | 显示全部楼层
回复 支持 反对

使用道具 举报

下一页 »
12下一页
返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2026-1-13 00:42 , Processed in 0.330374 second(s), 15 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表