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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › SPI经典IP核 verilog
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楼主: jiangyq

[资料] SPI经典IP核 verilog

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发表于 2015-6-26 10:18:08 | 显示全部楼层
谢谢分享
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guolh
发表于 2015-7-18 22:15:25 | 显示全部楼层
opencores的，浪费钱
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Ryggeor
发表于 2015-7-18 22:19:53 | 显示全部楼层
thnx!
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oyoyo
发表于 2015-7-19 03:05:48 | 显示全部楼层
it's so good!
thank you
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发表于 2015-8-11 15:30:32 | 显示全部楼层
感谢分享。
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发表于 2015-10-2 10:43:14 | 显示全部楼层
谢谢楼主分享
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发表于 2015-10-27 15:29:30 | 显示全部楼层
正在学习中。。。
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maocion
发表于 2015-10-27 20:29:54 | 显示全部楼层
回复 1# jiangyq


    非常感谢，最近正在找这方面的资料，之前查到的感觉讲得不怎样，先看看喽！
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发表于 2015-10-29 12:51:44 | 显示全部楼层
haohaokankan
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发表于 2016-1-9 18:06:53 | 显示全部楼层
多谢共享
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