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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › power supply noise对PLL jitter的影响

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[资料] power supply noise对PLL jitter的影响

whuchzhh whuchzhh 当前离线积分 4703 IP卡狗仔卡	发表于 2011-9-15 01:40:20 \| 显示全部楼层 \|阅读模式
whuchzhh whuchzhh 当前离线积分 4703 IP卡狗仔卡	相关帖子 • 在数字电路中有没有办法将NMOS管用作高边开关 • 关于offset对输出DC工作点的影响 • 时序分析，保持时间不满足有影响吗？ • 现在感觉chipscope对设计本身有影响，怎么解决呢？求前辈。。 • 介电常数变化对电场的影响，求解释 • 求助:hold time violation • 低压共源共栅电流镜线性区的问题 • DCDC内外补偿问题
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etopyes8 etopyes8 当前离线积分 3 IP卡狗仔卡	发表于 2011-9-15 07:02:44 \| 显示全部楼层
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alenanderson alenanderson 当前离线积分 43 IP卡狗仔卡	发表于 2011-9-15 11:37:27 \| 显示全部楼层
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xinlianxin xinlianxin 当前离线积分 50901 IP卡狗仔卡	发表于 2011-9-15 15:30:27 \| 显示全部楼层
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jamesccp jamesccp 当前离线积分 45964 IP卡狗仔卡	发表于 2011-9-16 16:31:43 \| 显示全部楼层
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ojrf ojrf 当前离线积分 25 IP卡狗仔卡	发表于 2011-9-23 23:12:21 \| 显示全部楼层
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kiteinsky kiteinsky 当前离线积分 33532 IP卡狗仔卡	发表于 2011-10-5 16:58:33 \| 显示全部楼层
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wslcf wslcf 当前离线积分 31 IP卡狗仔卡	发表于 2011-10-13 21:15:47 \| 显示全部楼层
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fanjx fanjx 当前离线积分 35359 IP卡狗仔卡	发表于 2012-11-11 20:22:22 \| 显示全部楼层
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ugi929 ugi929 当前离线积分 3340 IP卡狗仔卡	发表于 2012-12-10 14:01:58 \| 显示全部楼层
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