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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › FIFO使用技巧
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楼主: lucien_1986

[原创] FIFO使用技巧

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发表于 2014-9-30 10:55:13 | 显示全部楼层
挺好，将空将慢是做提高FIFO效率的基本做法。
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igloo11
发表于 2014-9-30 22:07:55 | 显示全部楼层
大有收获。
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发表于 2014-10-14 10:26:55 | 显示全部楼层
顶一个，写的很好
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发表于 2014-10-14 16:29:40 | 显示全部楼层
很深奥，在学习Verilog语言中
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发表于 2014-10-15 10:25:04 | 显示全部楼层
不错的讨论
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发表于 2015-8-10 16:10:58 | 显示全部楼层
涨姿势了！
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发表于 2015-8-10 18:32:14 | 显示全部楼层
赞一个，总结的很棒
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发表于 2016-8-1 13:59:19 | 显示全部楼层
正需要參考~感恩!!
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gwbing
发表于 2016-10-9 16:14:58 | 显示全部楼层
回复 1# lucien_1986


   thank u very much!
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发表于 2018-9-19 08:08:22 | 显示全部楼层
回复 1# lucien_1986


   感谢分享！！！
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