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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › Verification Methodology Manual for SystemVerilog

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楼主: pipiw

Verification Methodology Manual for SystemVerilog

发表于 2010-8-13 13:12:08 | 显示全部楼层

Thanks...

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发表于 2010-8-22 04:24:36 | 显示全部楼层

Thanks for your sharing.

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发表于 2011-10-22 15:15:42 | 显示全部楼层

要好好研究一下

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发表于 2011-12-18 15:06:01 | 显示全部楼层

Thank you very much

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发表于 2011-12-25 21:52:03 | 显示全部楼层

这么好的东西

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发表于 2013-3-2 14:42:17 | 显示全部楼层

下载看看。

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发表于 2013-3-6 18:05:05 | 显示全部楼层

thanka a alot

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发表于 2014-3-3 21:56:03 | 显示全部楼层

好东西~~~~

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