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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 华为海思采用的verilog编码规范
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楼主: knight0123

[资料] 华为海思采用的verilog编码规范

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发表于 2015-12-9 10:54:44 | 显示全部楼层
看一下子
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发表于 2015-12-10 13:56:48 | 显示全部楼层
学习一下
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发表于 2015-12-10 18:23:40 | 显示全部楼层
谢谢分享
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发表于 2015-12-11 01:03:38 | 显示全部楼层
回复 1# knight0123


   好东西，学习学习
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发表于 2015-12-11 09:03:58 | 显示全部楼层
回复 1# knight0123


  好银 顶一下
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发表于 2015-12-11 09:34:17 | 显示全部楼层
看看看看看看
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QQben
发表于 2015-12-11 09:47:07 | 显示全部楼层
谢谢分享
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发表于 2015-12-13 13:09:54 | 显示全部楼层
谢谢楼主
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发表于 2015-12-13 14:24:55 | 显示全部楼层
值得参考，增加程序可读性和规范性！
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srxh1h
发表于 2015-12-13 16:41:06 | 显示全部楼层
回复 1# knight0123


   学习
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