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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 华为海思采用的verilog编码规范
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楼主: knight0123

[资料] 华为海思采用的verilog编码规范

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发表于 2017-5-16 10:25:59 | 显示全部楼层
thanks~
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QQben
发表于 2017-5-16 14:09:52 | 显示全部楼层
谢谢分享
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emukwok
发表于 2017-5-18 10:03:37 | 显示全部楼层
看看哈，谢谢先
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发表于 2017-5-18 10:55:16 | 显示全部楼层
谢谢分享
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发表于 2017-5-23 17:13:41 | 显示全部楼层
好人一生平安
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发表于 2017-5-23 17:32:01 | 显示全部楼层
学习学习一下~~~
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发表于 2017-5-25 21:45:14 | 显示全部楼层
谢谢分享
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发表于 2017-5-27 15:26:03 | 显示全部楼层
thanks
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发表于 2017-6-6 10:00:07 | 显示全部楼层
学习一下
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发表于 2017-6-6 10:10:54 | 显示全部楼层
不错的，编程习惯很重要
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