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[求助] virtuoso 中用 nc-verilog 抽取verilog 网表,如何避免instance 以bus的形式被抽出

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发表于 2017-5-15 11:00:57 | 显示全部楼层 |阅读模式
发表于 2018-9-25 13:39:01 | 显示全部楼层
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发表于 2019-5-21 13:43:55 | 显示全部楼层
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发表于 2020-12-19 23:01:33 | 显示全部楼层
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发表于 2020-12-20 09:11:03 | 显示全部楼层
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发表于 2021-2-10 10:23:43 来自手机 | 显示全部楼层
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发表于 2021-7-3 00:02:12 | 显示全部楼层
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发表于 2021-7-7 15:50:40 | 显示全部楼层
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发表于 2021-8-10 18:11:32 | 显示全部楼层
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发表于 2021-12-7 18:38:58 | 显示全部楼层
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