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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2024-3-27 13:56:11 | 显示全部楼层
thanks
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发表于 2024-3-27 14:05:11 | 显示全部楼层
谢谢分享
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发表于 2024-3-27 14:28:21 来自手机 | 显示全部楼层
学习下
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解構
发表于 2024-3-28 13:27:32 | 显示全部楼层
谢谢楼主！！！！！！！！！！！！！！
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发表于 2024-3-28 14:20:59 | 显示全部楼层
看看
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aktwhh
发表于 2024-3-29 15:42:09 | 显示全部楼层
#在这里快速感谢分享！！！！！！！！！！！！！！回复#
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发表于 2024-3-29 17:01:33 | 显示全部楼层
谢谢
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yql1716
发表于 2024-4-4 21:59:19 | 显示全部楼层
看看看看
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wxtpa
发表于 2024-4-11 00:10:43 | 显示全部楼层
thanks
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发表于 2024-4-11 01:02:21 | 显示全部楼层
谢谢。
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